Added skeleton XHCI driver by Jian Chiang, based on the specs and the EHCI driver.
git-svn-id: file:///srv/svn/repos/haiku/haiku/trunk@41142 a95241bf-73f2-0310-859d-f6bbb57e9c96
This commit is contained in:
Jérôme Duval
@@ -25,3 +25,10 @@ KernelAddon <usb>ehci :
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: libusb.a
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: libusb.a
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: ehci.rdef
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: ehci.rdef
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;
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KernelAddon <usb>xhci :
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xhci.cpp
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: libusb.a
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: xhci.rdef
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;
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@@ -0,0 +1,453 @@
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/*
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* Copyright 2006-2011, Haiku Inc. All rights reserved.
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* Distributed under the terms of the MIT License.
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*
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* Some code borrowed from the Haiku EHCI driver
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* Authors:
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* Michael Lotz <[email protected]>
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* Jian Chiang <[email protected]>
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*/
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#include <module.h>
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#include <PCI.h>
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#include <USB3.h>
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#include <KernelExport.h>
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#define TRACE_USB
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#include "xhci.h"
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#define USB_MODULE_NAME "xhci"
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pci_module_info *XHCI::sPCIModule = NULL;
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static int32
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xhci_std_ops(int32 op, ...)
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{
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switch (op) {
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case B_MODULE_INIT:
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TRACE_MODULE("xhci init module\n");
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return B_OK;
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case B_MODULE_UNINIT:
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TRACE_MODULE("xhci uninit module\n");
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return B_OK;
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}
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return EINVAL;
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}
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usb_host_controller_info xhci_module = {
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{
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"busses/usb/xhci",
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0,
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xhci_std_ops
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},
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NULL,
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XHCI::AddTo
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};
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module_info *modules[] = {
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(module_info *)&xhci_module,
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NULL
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};
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XHCI::XHCI(pci_info *info, Stack *stack)
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: BusManager(stack),
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fCapabilityRegisters(NULL),
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fOperationalRegisters(NULL),
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fRegisterArea(-1),
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fPCIInfo(info),
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fStack(stack),
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fPortCount(0)
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{
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if (BusManager::InitCheck() < B_OK) {
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TRACE_ERROR("bus manager failed to init\n");
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return;
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}
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TRACE("constructing new XHCI host controller driver\n");
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fInitOK = false;
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// enable busmaster and memory mapped access
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uint16 command = sPCIModule->read_pci_config(fPCIInfo->bus,
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fPCIInfo->device, fPCIInfo->function, PCI_command, 2);
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command &= ~PCI_command_io;
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command |= PCI_command_master | PCI_command_memory;
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sPCIModule->write_pci_config(fPCIInfo->bus, fPCIInfo->device,
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|
fPCIInfo->function, PCI_command, 2, command);
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||||||
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|
// map the registers
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uint32 offset = fPCIInfo->u.h0.base_registers[0] & (B_PAGE_SIZE - 1);
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addr_t physicalAddress = fPCIInfo->u.h0.base_registers[0] - offset;
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size_t mapSize = (fPCIInfo->u.h0.base_register_sizes[0] + offset
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+ B_PAGE_SIZE - 1) & ~(B_PAGE_SIZE - 1);
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|
TRACE("map physical memory 0x%08lx (base: 0x%08lx; offset: %lx); size: %ld\n",
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fPCIInfo->u.h0.base_registers[0], physicalAddress, offset,
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fPCIInfo->u.h0.base_register_sizes[0]);
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|
fRegisterArea = map_physical_memory("EHCI memory mapped registers",
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physicalAddress, mapSize, B_ANY_KERNEL_BLOCK_ADDRESS,
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B_KERNEL_READ_AREA | B_KERNEL_WRITE_AREA | B_READ_AREA | B_WRITE_AREA,
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|
(void **)&fCapabilityRegisters);
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if (fRegisterArea < B_OK) {
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TRACE("failed to map register memory\n");
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return;
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}
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fCapabilityRegisters += offset;
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fOperationalRegisters = fCapabilityRegisters + ReadCapReg8(XHCI_CAPLENGTH);
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fRuntimeRegisters = fCapabilityRegisters + ReadCapReg8(XHCI_RTSOFF);
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TRACE("mapped capability registers: 0x%08lx\n", (uint32)fCapabilityRegisters);
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TRACE("mapped operational registers: 0x%08lx\n", (uint32)fOperationalRegisters);
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|
TRACE("mapped rumtime registers: 0x%08lx\n", (uint32)fRuntimeRegisters);
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||||||
|
TRACE("structural parameters1: 0x%08lx\n", ReadCapReg32(XHCI_HCSPARAMS1));
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|
TRACE("structural parameters2: 0x%08lx\n", ReadCapReg32(XHCI_HCSPARAMS2));
|
||||||
|
TRACE("structural parameters3: 0x%08lx\n", ReadCapReg32(XHCI_HCSPARAMS3));
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||||||
|
TRACE("capability parameters: 0x%08lx\n", ReadCapReg32(XHCI_HCCPARAMS));
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|
// read port count from capability register
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|
fPortCount = (ReadCapReg32(XHCI_HCSPARAMS1) >> 24) & 0x7f;
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|
uint32 extendedCapPointer = ((ReadCapReg32(XHCI_HCCPARAMS) >> 16) & 0xffff)
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<< 2;
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|
if (extendedCapPointer > 0) {
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||||||
|
TRACE("extended capabilities register at %ld\n", extendedCapPointer);
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||||||
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||||||
|
uint32 legacySupport = ReadCapReg32(extendedCapPointer);
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||||||
|
if ((legacySupport & XHCI_LEGSUP_CAPID_MASK) == XHCI_LEGSUP_CAPID) {
|
||||||
|
if ((legacySupport & XHCI_LEGSUP_BIOSOWNED) != 0) {
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||||||
|
TRACE_ALWAYS("the host controller is bios owned, claiming"
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|
" ownership\n");
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||||||
|
WriteCapReg32(extendedCapPointer, legacySupport
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|
| XHCI_LEGSUP_OSOWNED);
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||||||
|
for (int32 i = 0; i < 20; i++) {
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||||||
|
legacySupport = ReadCapReg32(extendedCapPointer);
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||||||
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||||||
|
if ((legacySupport & XHCI_LEGSUP_BIOSOWNED) == 0)
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|
break;
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||||||
|
TRACE_ALWAYS("controller is still bios owned, waiting\n");
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snooze(50000);
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|
}
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|
}
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|
|
||||||
|
if (legacySupport & XHCI_LEGSUP_BIOSOWNED) {
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||||||
|
TRACE_ERROR("bios won't give up control over the host "
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|
"controller (ignoring)\n");
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||||||
|
} else if (legacySupport & XHCI_LEGSUP_OSOWNED) {
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|
TRACE_ALWAYS("successfully took ownership of the host "
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|
"controller\n");
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|
}
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|
// Force off the BIOS owned flag, and clear all SMIs. Some BIOSes
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|
// do indicate a successful handover but do not remove their SMIs
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|
// and then freeze the system when interrupts are generated.
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|
WriteCapReg32(extendedCapPointer, legacySupport & ~XHCI_LEGSUP_BIOSOWNED);
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||||||
|
WriteCapReg32(extendedCapPointer + XHCI_LEGCTLSTS,
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|
XHCI_LEGCTLSTS_DISABLE_SMI);
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||||||
|
} else {
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||||||
|
TRACE("extended capability is not a legacy support register\n");
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||||||
|
}
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||||||
|
} else {
|
||||||
|
TRACE("no extended capabilities register\n");
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||||||
|
}
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|
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||||||
|
// halt the host controller
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if (ControllerHalt() < B_OK) {
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||||||
|
return;
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|
}
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||||||
|
// reset the host controller
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||||||
|
if (ControllerReset() < B_OK) {
|
||||||
|
TRACE_ERROR("host controller failed to reset\n");
|
||||||
|
return;
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||||||
|
}
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||||||
|
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|
fInitOK = true;
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||||||
|
TRACE("XHCI host controller driver constructed\n");
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|
}
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XHCI::~XHCI()
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{
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|
TRACE("tear down XHCI host controller driver\n");
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||||||
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|
WriteOpReg(XHCI_CMD, 0);
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||||||
|
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||||||
|
delete_area(fRegisterArea);
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||||||
|
put_module(B_PCI_MODULE_NAME);
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|
}
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|
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||||||
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status_t
|
||||||
|
XHCI::Start()
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{
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||||||
|
TRACE("starting XHCI host controller\n");
|
||||||
|
TRACE("usbcmd: 0x%08lx; usbsts: 0x%08lx\n", ReadOpReg(XHCI_CMD),
|
||||||
|
ReadOpReg(XHCI_STS));
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||||||
|
|
||||||
|
TRACE_ALWAYS("successfully started the controller\n");
|
||||||
|
return BusManager::Start();
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||||||
|
}
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||||||
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||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::SubmitTransfer(Transfer *transfer)
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|
{
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||||||
|
return B_OK;
|
||||||
|
}
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|
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||||||
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||||||
|
status_t
|
||||||
|
XHCI::CancelQueuedTransfers(Pipe *pipe, bool force)
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|
{
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||||||
|
return B_OK;
|
||||||
|
}
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||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::NotifyPipeChange(Pipe *pipe, usb_change change)
|
||||||
|
{
|
||||||
|
TRACE("pipe change %d for pipe %p\n", change, pipe);
|
||||||
|
switch (change) {
|
||||||
|
case USB_CHANGE_CREATED:
|
||||||
|
case USB_CHANGE_DESTROYED: {
|
||||||
|
// ToDo: we should create and keep a single queue head
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||||||
|
// for all transfers to/from this pipe
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||||||
|
break;
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||||||
|
}
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||||||
|
|
||||||
|
case USB_CHANGE_PIPE_POLICY_CHANGED: {
|
||||||
|
// ToDo: for isochronous pipes we might need to adapt to new
|
||||||
|
// pipe policy settings here
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||||||
|
break;
|
||||||
|
}
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||||||
|
}
|
||||||
|
|
||||||
|
return B_OK;
|
||||||
|
}
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|
|
||||||
|
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|
status_t
|
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|
XHCI::AddTo(Stack *stack)
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|
{
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|
#ifdef TRACE_USB
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|
set_dprintf_enabled(true);
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|
#ifndef HAIKU_TARGET_PLATFORM_HAIKU
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|
load_driver_symbols("xhci");
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||||||
|
#endif
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||||||
|
#endif
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|
if (!sPCIModule) {
|
||||||
|
status_t status = get_module(B_PCI_MODULE_NAME,
|
||||||
|
(module_info **)&sPCIModule);
|
||||||
|
if (status < B_OK) {
|
||||||
|
TRACE_MODULE_ERROR("getting pci module failed! 0x%08lx\n", status);
|
||||||
|
return status;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
TRACE_MODULE("searching devices\n");
|
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|
bool found = false;
|
||||||
|
pci_info *item = new(std::nothrow) pci_info;
|
||||||
|
if (!item) {
|
||||||
|
sPCIModule = NULL;
|
||||||
|
put_module(B_PCI_MODULE_NAME);
|
||||||
|
return B_NO_MEMORY;
|
||||||
|
}
|
||||||
|
|
||||||
|
for (int32 i = 0; sPCIModule->get_nth_pci_info(i, item) >= B_OK; i++) {
|
||||||
|
if (item->class_base == PCI_serial_bus && item->class_sub == PCI_usb
|
||||||
|
&& item->class_api == PCI_usb_xhci) {
|
||||||
|
if (item->u.h0.interrupt_line == 0
|
||||||
|
|| item->u.h0.interrupt_line == 0xFF) {
|
||||||
|
TRACE_MODULE_ERROR("found device with invalid IRQ - check IRQ "
|
||||||
|
"assignment\n");
|
||||||
|
continue;
|
||||||
|
}
|
||||||
|
|
||||||
|
TRACE_MODULE("found device at IRQ %u\n",
|
||||||
|
item->u.h0.interrupt_line);
|
||||||
|
XHCI *bus = new(std::nothrow) XHCI(item, stack);
|
||||||
|
if (!bus) {
|
||||||
|
delete item;
|
||||||
|
sPCIModule = NULL;
|
||||||
|
put_module(B_PCI_MODULE_NAME);
|
||||||
|
return B_NO_MEMORY;
|
||||||
|
}
|
||||||
|
|
||||||
|
if (bus->InitCheck() < B_OK) {
|
||||||
|
TRACE_MODULE_ERROR("bus failed init check\n");
|
||||||
|
delete bus;
|
||||||
|
continue;
|
||||||
|
}
|
||||||
|
|
||||||
|
// the bus took it away
|
||||||
|
item = new(std::nothrow) pci_info;
|
||||||
|
|
||||||
|
bus->Start();
|
||||||
|
stack->AddBusManager(bus);
|
||||||
|
found = true;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
|
if (!found) {
|
||||||
|
TRACE_MODULE_ERROR("no devices found\n");
|
||||||
|
delete item;
|
||||||
|
sPCIModule = NULL;
|
||||||
|
put_module(B_PCI_MODULE_NAME);
|
||||||
|
return ENODEV;
|
||||||
|
}
|
||||||
|
|
||||||
|
delete item;
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::GetPortStatus(uint8 index, usb_port_status *status)
|
||||||
|
{
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::SetPortFeature(uint8 index, uint16 feature)
|
||||||
|
{
|
||||||
|
return B_BAD_VALUE;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::ClearPortFeature(uint8 index, uint16 feature)
|
||||||
|
{
|
||||||
|
return B_BAD_VALUE;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::ResetPort(uint8 index)
|
||||||
|
{
|
||||||
|
TRACE("reset port %d\n", index);
|
||||||
|
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::SuspendPort(uint8 index)
|
||||||
|
{
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::ControllerHalt()
|
||||||
|
{
|
||||||
|
WriteOpReg(XHCI_CMD, 0);
|
||||||
|
|
||||||
|
int32 tries = 100;
|
||||||
|
while ((ReadOpReg(XHCI_STS) & STS_HCH) == 0) {
|
||||||
|
snooze(1000);
|
||||||
|
if (tries-- < 0)
|
||||||
|
return B_ERROR;
|
||||||
|
}
|
||||||
|
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::ControllerReset()
|
||||||
|
{
|
||||||
|
WriteOpReg(XHCI_CMD, CMD_HCRST);
|
||||||
|
|
||||||
|
int32 tries = 100;
|
||||||
|
while (ReadOpReg(XHCI_CMD) & CMD_HCRST) {
|
||||||
|
snooze(1000);
|
||||||
|
if (tries-- < 0)
|
||||||
|
return B_ERROR;
|
||||||
|
}
|
||||||
|
|
||||||
|
tries = 100;
|
||||||
|
while (ReadOpReg(XHCI_STS) & STS_CNR) {
|
||||||
|
snooze(1000);
|
||||||
|
if (tries-- < 0)
|
||||||
|
return B_ERROR;
|
||||||
|
}
|
||||||
|
|
||||||
|
return B_OK;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
status_t
|
||||||
|
XHCI::LightReset()
|
||||||
|
{
|
||||||
|
return B_ERROR;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
int32
|
||||||
|
XHCI::InterruptHandler(void *data)
|
||||||
|
{
|
||||||
|
return ((XHCI *)data)->Interrupt();
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
int32
|
||||||
|
XHCI::Interrupt()
|
||||||
|
{
|
||||||
|
int32 result = B_HANDLED_INTERRUPT;
|
||||||
|
|
||||||
|
return result;
|
||||||
|
}
|
||||||
|
|
||||||
|
inline void
|
||||||
|
XHCI::WriteOpReg(uint32 reg, uint32 value)
|
||||||
|
{
|
||||||
|
*(volatile uint32 *)(fOperationalRegisters + reg) = value;
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
inline uint32
|
||||||
|
XHCI::ReadOpReg(uint32 reg)
|
||||||
|
{
|
||||||
|
return *(volatile uint32 *)(fOperationalRegisters + reg);
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
inline uint8
|
||||||
|
XHCI::ReadCapReg8(uint32 reg)
|
||||||
|
{
|
||||||
|
return *(volatile uint8 *)(fCapabilityRegisters + reg);
|
||||||
|
}
|
||||||
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|
inline uint16
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||||||
|
XHCI::ReadCapReg16(uint32 reg)
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|
{
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|
return *(volatile uint16 *)(fCapabilityRegisters + reg);
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
inline uint32
|
||||||
|
XHCI::ReadCapReg32(uint32 reg)
|
||||||
|
{
|
||||||
|
return *(volatile uint32 *)(fCapabilityRegisters + reg);
|
||||||
|
}
|
||||||
|
|
||||||
|
|
||||||
|
inline void
|
||||||
|
XHCI::WriteCapReg32(uint32 reg, uint32 value)
|
||||||
|
{
|
||||||
|
*(volatile uint32 *)(fCapabilityRegisters + reg) = value;
|
||||||
|
}
|
||||||
|
|
||||||
@@ -0,0 +1,83 @@
|
|||||||
|
/*
|
||||||
|
* Copyright 2006-2011, Haiku Inc. All rights reserved.
|
||||||
|
* Distributed under the terms of the MIT License.
|
||||||
|
*
|
||||||
|
* Authors:
|
||||||
|
* Michael Lotz <[email protected]>
|
||||||
|
* Jian Chiang <[email protected]>
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|
*/
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|
#ifndef XHCI_H
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#define XHCI_H
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#include "usb_private.h"
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|
#include "xhci_hardware.h"
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struct pci_info;
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|
struct pci_module_info;
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class XHCI : public BusManager {
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public:
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XHCI(pci_info *info, Stack *stack);
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|
~XHCI();
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|
status_t Start();
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|
virtual status_t SubmitTransfer(Transfer *transfer);
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|
virtual status_t CancelQueuedTransfers(Pipe *pipe, bool force);
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|
virtual status_t NotifyPipeChange(Pipe *pipe,
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|
usb_change change);
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static status_t AddTo(Stack *stack);
|
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// Port operations for root hub
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uint8 PortCount() { return fPortCount; };
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status_t GetPortStatus(uint8 index, usb_port_status *status);
|
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status_t SetPortFeature(uint8 index, uint16 feature);
|
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|
status_t ClearPortFeature(uint8 index, uint16 feature);
|
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|
status_t ResetPort(uint8 index);
|
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|
status_t SuspendPort(uint8 index);
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|
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|
virtual const char * TypeName() const { return "xhci"; };
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|
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|
private:
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|
// Controller resets
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|
status_t ControllerReset();
|
||||||
|
status_t ControllerHalt();
|
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|
status_t LightReset();
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|
|
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|
// Interrupt functions
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|
static int32 InterruptHandler(void *data);
|
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|
int32 Interrupt();
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|
// Operational register functions
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inline void WriteOpReg(uint32 reg, uint32 value);
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|
inline uint32 ReadOpReg(uint32 reg);
|
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|
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|
// Capability register functions
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|
inline uint8 ReadCapReg8(uint32 reg);
|
||||||
|
inline uint16 ReadCapReg16(uint32 reg);
|
||||||
|
inline uint32 ReadCapReg32(uint32 reg);
|
||||||
|
inline void WriteCapReg32(uint32 reg, uint32 value);
|
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|
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|
static pci_module_info * sPCIModule;
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|
uint8 * fCapabilityRegisters;
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|
uint8 * fOperationalRegisters;
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|
uint8 * fRuntimeRegisters;
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|
area_id fRegisterArea;
|
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|
pci_info * fPCIInfo;
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|
Stack * fStack;
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|
// Root Hub
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|
// Port management
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|
uint8 fPortCount;
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|
};
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|
#endif // !XHCI_H
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@@ -0,0 +1,15 @@
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/*
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|
* xhci.rdef
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|
*/
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||||||
|
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||||||
|
resource app_signature "application/x-vnd.haiku-xhci";
|
||||||
|
|
||||||
|
resource app_version {
|
||||||
|
major = 1,
|
||||||
|
middle = 0,
|
||||||
|
minor = 0,
|
||||||
|
variety = 0,
|
||||||
|
internal = 0,
|
||||||
|
short_info = "XHCI host controller driver",
|
||||||
|
long_info = "Haiku XHCI HCD - Copyright 2011, Haiku Inc."
|
||||||
|
};
|
||||||
@@ -0,0 +1,50 @@
|
|||||||
|
/*
|
||||||
|
* Copyright 2011, Haiku Inc. All rights reserved.
|
||||||
|
* Distributed under the terms of the MIT License.
|
||||||
|
*
|
||||||
|
* Authors:
|
||||||
|
* Jian Chiang <[email protected]>
|
||||||
|
*/
|
||||||
|
#ifndef XHCI_HARDWARE_H
|
||||||
|
#define XHCI_HARDWARE_H
|
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|
// Host Controller Capability Registers
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#define XHCI_CAPLENGTH 0x00 // Capability Register Length
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#define XHCI_HCIVERSION 0x02 // Interface Version Number
|
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|
#define XHCI_HCSPARAMS1 0x04 // Structural Parameters 1
|
||||||
|
#define XHCI_HCSPARAMS2 0x08 // Structural Parameters 2
|
||||||
|
#define XHCI_HCSPARAMS3 0x0C // Structural Parameters 3
|
||||||
|
#define XHCI_HCCPARAMS 0x10 // Capability Parameters
|
||||||
|
#define XHCI_RTSOFF 0x18 // Runtime Register Space offset
|
||||||
|
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||||||
|
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||||||
|
// Host Controller Operational Registers
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|
#define XHCI_CMD 0x00 // USB Command
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|
#define XHCI_STS 0x04 // USB Status
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|
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|
// USB Command Register
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|
#define CMD_HCRST (1 << 1) // Host Controller Reset
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|
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||||||
|
|
||||||
|
// USB Status Register
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|
#define STS_HCH (1<<0)
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|
#define STS_CNR (1<<11)
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|
// Extended Capabilities
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#define XHCI_LEGSUP_CAPID_MASK 0xff
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|
#define XHCI_LEGSUP_CAPID 0x01
|
||||||
|
#define XHCI_LEGSUP_OSOWNED (1 << 24) // OS Owned Semaphore
|
||||||
|
#define XHCI_LEGSUP_BIOSOWNED (1 << 16) // BIOS Owned Semaphore
|
||||||
|
|
||||||
|
#define XHCI_LEGCTLSTS 0x04
|
||||||
|
#define XHCI_LEGCTLSTS_DISABLE_SMI ((0x3 << 1) + (0xff << 5) + (0x7 << 17))
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|
||||||
|
|
||||||
|
#endif // !XHCI_HARDWARE_H
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|
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